• einer Strukturgröße von 22 nm. Betriebsspannung: fällt mit fallender Strukturgröße Maximale Schaltfrequenz: steigt mit fallender Strukturgröße Verlustleistung...
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  • sich im Wesentlichen auf die kleinste fotolithografisch herstellbare Strukturgröße. Seit 1997 wird er durch die International Technology Roadmap for Semiconductors...
    44 KB (3,818 words) - 22:56, 11 July 2024
  • und im Labor befasste man sich damals bereits mit wiederum kleineren Strukturgrößen. So wurden schon erste Prototyp-Transistoren mit 10 nm Gatelänge gefertigt...
    21 KB (2,262 words) - 09:14, 12 April 2024
  • erheblich von der verwendeten Strukturgröße ab. Computerchips auf einem durchschnittlichen 200-mm-Wafer mit einer Strukturgröße von 90 nm (90-nm-Technologie)...
    14 KB (1,294 words) - 17:27, 10 June 2024
  • Stand der Technik war seit 2008 die Herstellung von Chips mit einer Strukturgröße von 40 Nanometern (im 40-nm-Prozess) durch die 193-nm-Immersionslithografie...
    31 KB (1,987 words) - 18:27, 28 July 2024
  • Technologiebeschreibung für die Prozesse in der Halbleiterfertigung, siehe Strukturgröße Plug-in Development Kit – Toolpaket zur Softwareentwicklung zum Beispiel...
    1 KB (126 words) - 07:46, 13 February 2024
  • pro Prozessorkern 1 MB L2-Cache für alle drei Prozessorkerne 32-nm-Strukturgröße (später produzierte Xbox 360 E, Winchester-Revision), 45 nm (ab Xbox...
    95 KB (10,221 words) - 11:22, 30 July 2024
  • -schwerpunkte (engl. nodes) werden über den Begriff der Strukturgröße (bzw. der minimalen Strukturgröße) definiert. Die Richtungsvorgabe bei der Entwicklung...
    28 KB (2,883 words) - 17:29, 19 February 2024
  • bereits Strukturgrößen von 22 nm erzielt werden. Eine Kombination von Double-Patterning und der 32-nm-Immersionslithografie könnte gar eine Strukturgröße von...
    43 KB (4,934 words) - 23:36, 3 July 2024
  • Die Strukturgröße nimmt dabei stufenweise in höheren Ebenen zu, beispielsweise sind die ersten beiden Ebenen in der kleinstmöglichen Strukturgröße (1×)...
    51 KB (5,572 words) - 13:55, 27 August 2024
  • Reinraum mit 3500 m² und eine Technologielinie für 125-mm-Wafer. Minimale Strukturgröße der CMOS-Technologie war 1,25 µm. 1990 stellte das Imec seine Fertigung...
    6 KB (678 words) - 13:39, 5 February 2024